电子与信息学报
電子與信息學報
전자여신식학보
JOURNAL OF ELECTRONICS & INFORMATION TECHNOLOGY
2011年
3期
717-722
,共6页
陈运必%郭立%李正东%池凌鸿
陳運必%郭立%李正東%池凌鴻
진운필%곽립%리정동%지릉홍
运动估计%比特变换%硬件架构%并行处理%脉动阵列
運動估計%比特變換%硬件架構%併行處理%脈動陣列
운동고계%비특변환%경건가구%병행처리%맥동진렬
为了满足便携式实时全高清视频的处理要求,该文基于1维源像素线性阵列,提出一种新的多宏块并行比特变换运动估计结构,克服以往2维阵列消耗资源较多且延时大的不足.该文结构易于并行扩展且更为节约资源,进一步还针对脉动胞元和数据存储器这两个系统瓶颈进行优化设计.FPGA实现结果表明,与同类设计相比,该文设计在面积和速度上均有改善,LUTs资源节约43%,DFFs资源节约25%,BRAMs数目节约75%,性能提升32%.
為瞭滿足便攜式實時全高清視頻的處理要求,該文基于1維源像素線性陣列,提齣一種新的多宏塊併行比特變換運動估計結構,剋服以往2維陣列消耗資源較多且延時大的不足.該文結構易于併行擴展且更為節約資源,進一步還針對脈動胞元和數據存儲器這兩箇繫統瓶頸進行優化設計.FPGA實現結果錶明,與同類設計相比,該文設計在麵積和速度上均有改善,LUTs資源節約43%,DFFs資源節約25%,BRAMs數目節約75%,性能提升32%.
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