电视技术
電視技術
전시기술
TV ENGINEERING
2012年
21期
105-108
,共4页
并入并检%帧同步%FPGA
併入併檢%幀同步%FPGA
병입병검%정동보%FPGA
针对高速串行码流或并行码流的同步搜索,提出一种新的并入并检AOS帧同步检测方法,该方法在FPGA平台上,采用了并行帧同步码检测器来降低芯片的处理时钟频率,具有处理时钟频率低、误锁概率小、平均同步时间短以及芯片资源使用少等特点.
針對高速串行碼流或併行碼流的同步搜索,提齣一種新的併入併檢AOS幀同步檢測方法,該方法在FPGA平檯上,採用瞭併行幀同步碼檢測器來降低芯片的處理時鐘頻率,具有處理時鐘頻率低、誤鎖概率小、平均同步時間短以及芯片資源使用少等特點.
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