电子测量与仪器学报
電子測量與儀器學報
전자측량여의기학보
JOURNAL OF ELECTRONIC MEASUREMENT AND INSTRUMENT
2013年
6期
492-497
,共6页
级联%陷波器%窄带干扰%FPGA
級聯%陷波器%窄帶榦擾%FPGA
급련%함파기%착대간우%FPGA
cascade%notch filter%narrow-band interference%FPGA
针对扩频通信系统中常见的带宽较宽的强窄带干扰,提出了一种基于级联滤波器的干扰抑制方法,并对其抑制性能进行了仿真,最后针对该方案在FPGA上进行了优化设计并加以实现,对实现效果进行了性能测试.仿真和测试结果表明,设计的级联滤波器对于占有用信号扩频带宽1/10的窄带干扰可以达到40 dB的抗干扰性能,且占用硬件资源少,当采用常用的赛灵思600万门的FPGA实现时,仅占用4%的逻辑资源,在航空、航天等资源受限的场合具有较强的工程应用价值.
針對擴頻通信繫統中常見的帶寬較寬的彊窄帶榦擾,提齣瞭一種基于級聯濾波器的榦擾抑製方法,併對其抑製性能進行瞭倣真,最後針對該方案在FPGA上進行瞭優化設計併加以實現,對實現效果進行瞭性能測試.倣真和測試結果錶明,設計的級聯濾波器對于佔有用信號擴頻帶寬1/10的窄帶榦擾可以達到40 dB的抗榦擾性能,且佔用硬件資源少,噹採用常用的賽靈思600萬門的FPGA實現時,僅佔用4%的邏輯資源,在航空、航天等資源受限的場閤具有較彊的工程應用價值.
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