现代电子技术
現代電子技術
현대전자기술
MODERN ELECTRONICS TECHNIQUE
2012年
14期
169-171
,共3页
FPGA%三相锁相环%乘法复用%CORDIC
FPGA%三相鎖相環%乘法複用%CORDIC
FPGA%삼상쇄상배%승법복용%CORDIC
数字三相锁相环中含有大量乘法运算和三角函数运算,占用大量的硬件逻辑资源.为此,提出一种数字三相锁相环的优化实现方案,利用乘法模块复用和CORDIC算法实现三角函数运算,并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现.仿真和实验结果表明,优化后的数字三相锁相环大大节省了FPGA的资源,并能快速、准确地锁定相位,具有良好的性能.
數字三相鎖相環中含有大量乘法運算和三角函數運算,佔用大量的硬件邏輯資源.為此,提齣一種數字三相鎖相環的優化實現方案,利用乘法模塊複用和CORDIC算法實現三角函數運算,併用Verilog HDL硬件描述語言對優化前後的算法進行瞭編碼實現.倣真和實驗結果錶明,優化後的數字三相鎖相環大大節省瞭FPGA的資源,併能快速、準確地鎖定相位,具有良好的性能.
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